Desarrollan chips con mayor capacidad de procesamiento

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Un estudio liderado por investigadores de la Universitat Politècnica de València (España) permite diseñar chips de altas prestaciones con mayor capacidad de procesamiento.

La clave reside en la incorporación de un nuevo modelo de línea de retardo que ocupa mucho menos espacio en el chip, hasta 300 veces menos, y que ha sido ideado por Ivana Gasulla, investigadora del Instituto de Telecomunicaciones y Aplicaciones Multimedia (iTEAM) de la UPV. Junto al equipo del iTEAM, en el estudio han participado también investigadores de la Universidad McGill de Canadá y la Universidad de Strathclyde, en Glasgow (Escocia).

“Las líneas de retardo se utilizan en todo tipo de comunicaciones para procesar datos, para retener información que posteriormente queremos analizar de una forma individual.

Son un componente fundamental en los chips; nuestro nuevo dispositivo, fabricado con tecnología fotónica de silicio estándar, abre la puerta a conseguir chips con más prestaciones; al reducirse el espacio ocupado por la línea de retardo, podemos incorporar nuevos componentes al circuito”, apunta José Capmany, director del iTEAM.

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“La red permite ahorrar espacio y componentes adicionales ya que la señal se retarda en transmisión y no en reflexión, por lo que no es necesario añadir acopladores ni circuladores para extraer la señal retardada al exterior”, explica Gasulla.

Los investigadores españoles, canadienses y escoceses han demostrado las prestaciones de este nuevo modelo de línea de retardo para comunicaciones digitales, alimentación de antenas, sistemas de comunicaciones móviles y buffers de memoria.

“Se puede aplicar en todos aquellos campos en los que se necesita retardar un bit para analizar una muestra. Además de aquellos en los que hemos testeado el equipo, podría aplicarse también para biofotónica”, añade Capmany.

Fuente: Noticias de la Ciencia